从Java转到Python，阅读源码的时候发现了一些有趣的小用法，在这里总结一下。for和if的简化代码为：list1 = [1, 2, 3, 4, 5, 6, 7 ]
rs = ([r if r%2==0 else r+10 for r in list2])
print rs执行结果为：[11, 2, 13, 4, 15, 6, 17]代码里对for和if进行了简化，并对if进行后置这里的fo
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2023-10-04 13:55:48
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# 利用 Python 实现 IC 设计 Workflow 的科普文章
集成电路（IC）设计是一个复杂的过程，涉及多个步骤，包括规格定义、设计、验证与制造等。随着科技的发展，Python 作为一种易用且功能强大的编程语言，越来越多地被应用于 IC 设计的流水线（flow）中。本文将探讨如何利用 Python 实现 IC 设计流程，并通过示例代码进行阐述。
## IC 设计流程概述
IC 设计
原创
2024-09-15 05:53:54
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责编 | 寇雪芹头图 | 下载于视觉中国什么是pythonicpythonic是开发者们在写python代码过程中总结的编程习惯，崇尚优雅、明确、简单。就好比中文的笔画，讲究先后顺序，最符合文字书写的习惯。因为是习惯，不是江湖规则，所以你大可不必遵守pythonic，但如果你想成为python高手，最好是养成这个习惯。对比其他语言，我们能直观看出pythonic风格的特点，比如
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2024-01-26 09:02:14
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介绍在我们开始探索如何写一个Pythonic对象之前，让我们先弄清楚这个术语的含义它不是关于PEP8和尊重其规则来编写漂亮的python代码；而是关于编写对象，最大限度地使用Python数据模型的概念，因此它们可以像Python标准库对象一样被自然地使用。其思想是将Python ADN注入到我们的用户定义对象中，使它们发生变异，并表现为本地Python对象为此，我们将实现一个向量类来表示多维向量。
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2024-06-09 00:59:09
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# IC设计与Python：探索电子设计的未来
集成电路（IC）设计是电子工程的重要组成部分，涉及到电路的设计、测试、制造和优化。随着科技的发展，Python逐渐成为IC设计领域的重要工具。本文将介绍如何通过Python与IC设计相结合，提升设计效率，并展示相关的代码示例。
## Python在IC设计中的应用
Python作为一种高级编程语言，以其简洁的语法和强大的库支持，逐渐被应用于多个
学习理念：Verilog是描述语言，是先要规划好电路结构，有大致框架的认知，再由认知反映到coding上去！不要反过来，直接做coding 仿真，需要有前期的规划！！！这需要不断的训练。目录1.数字IC/IP设计流程1.数字IP设计流程2.数字IC设计流程（参考）2.可综合Verilog语言设计1.组合逻辑2.时序逻辑3.Generate使用4.参数化的IP设计5.“<=” 和 “=”的区别
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2023-11-28 02:47:13
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# Python在IC设计中的应用
IC（Integrated Circuit，集成电路）是现代电子领域的重要组成部分，它包含了大量的电子元器件，如晶体管、电容、电阻等，将它们集成在一片芯片上。IC设计是指将电路设计转化为实际的芯片布局，并进行验证和优化的过程。
Python作为一种通用的编程语言，具有简单易学、强大且丰富的库支持的特点，也被广泛应用于IC设计中。在本文中，我们将介绍Pytho
原创
2023-12-09 11:09:24
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震惊，这篇文章的阅读量竟然远远超过我写的其他很多好文章，可见现在Python的学习有多么火热了。因为是早期写的文章，质量很一般，看到这么多访问着实惶恐，现在本人主要致力于前端学习，但是Python作为带我入门的语言，自然还是十分喜欢的， 随着越学越多，对于语言风格其实有了更深的认识，推荐大家不要局限于一种语言的设计风格，如果真的爱，请博采众长，以集大成。下面是原文，基本没有修改过，小白看
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2023-09-26 17:06:12
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1. 设计模式的优点设计模式可以再多个项目中重复使用问题可以再架构级别得到解决所有的设计模式都经过了时间的验证和良好的证明,是开发人员和架构师的宝贵经验设计模式都具有可靠性和依赖性2. 设计模式的分类代码段:用某种语言编写的一段具有特定用途的代码,例如,他可以是Python中的DB连接代码设计:用来解决某个特定问题的优秀解决方案标准:这是一种解决某类问题的方法,它非常通用,并且适用于当前情况模式:
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2024-06-22 11:48:09
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文章目录数字IC设计流程前端设计RTL编写和HDL仿真逻辑综合门级仿真形式化验证后端设计数据准备set mw_phys_refs *set link_library *数据准备 (SDC)数据准备 (RC Techfile) set_tlu_plus_filesfloor planFloorplan阶段的主要内容：常用命令：placement概念：常用命令：cts为什么要时钟树综合？时钟树综合的
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2024-07-30 10:11:48
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1.使用语言：VHDL/verilog HDL2.各阶段典型软件介绍：输入工具： Summit &nbs
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2023-07-27 12:05:36
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Python最大的优点之一就是语法简洁，好的代码就像伪代码一样，干净、整洁、一目了然。要写出 Pythonic（优雅的、地道的、整洁的）代码，需要多看多学大牛们写的代码，github 上有很多非常优秀的源代码值得阅读，比如：requests、flask、tornado，下面列举一些常见的Pythonic写法。0. 程序必须先让人读懂，然后才能让计算机执行。“Programs must be wri
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2023-12-19 17:26:25
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提示：文章写完后，目录可以自动生成，如何生成可参考右边的帮助文档 文章目录一、数字IC设计的流程 提示：以下是本篇文章正文内容，下面案例可供参考一、数字IC设计的流程数字IC设计大致上是分为前端和后端设计，前端设计就是从输入需求到输出网表的过程。根据需求制定Spec并进行RTL设计，包括把各种IP集成在一起，芯片功能完成后需要做DFT测试（在芯片内部引出引脚，方便后续对芯片的功能进行测试，功能是否
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2023-12-13 11:32:46
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数字IC设计流程是每个IC从业者的第一课，无论你是做前端，后端，还是验证，都需要对芯片的整个设计流程有个基本的了解。本文章主要介绍以下两点内容：一、数字IC设计的流程及每个流程需要做的工作二、每个流程涉及到的EDA工具 在介绍设计流程之前，我们先来看看数字芯片内部的架构。如下图所示，一个芯片是包含很多模块的，有CPU，DSP，USB外设，memory等，然后通过总线连接，通常我们都是把各
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2024-06-03 06:22:23
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寄生电容产生的原因 寄生电容一般是指电感，电阻，芯片引脚等在高频情况下表现出来的电容特性。实际上，一个电阻等效于一个电容，一个电感，和一个电阻的串联，在低频情况下表现不是很明显，而在高频情况下，等效值会增大，不能忽略。在计算中我们要考虑进去。ESL就是等效电感，ESR就是等效电阻。不管是电阻，电容，电感，还是二极管，三极管，MOS管，还有IC，在高频的情况下我们都要考虑到它们的等效电容值，电感值
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2023-11-29 14:31:24
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Python最大的优点之一就是语法简洁，好的代码就像伪代码一样，干净、整洁、一目了然。
要写出 Pythonic（优雅的、地道的、整洁的）代码，需要多看多学大牛们写的代码，github 上有很多非常优秀的源代码值得阅读，比如：requests、flask、tornado，下面列举一些常见的Pythonic写法。0. 程序必须先让人读懂，然后才能让计算机执行。“Programs must
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2024-01-04 00:23:18
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Python是一门很优雅的语言，有一些不同于C/C++的专有用法，使得python的编码变得简洁明了。先看看python中的八荣八耻：以动手实践为荣 , 以只看不练为耻 ; 以打印日志为荣 , 以单步跟踪为耻 ; 以空格缩进为荣 , 以制表缩进为耻 ; 以单元测试为荣
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2023-12-19 22:34:53
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通过前两篇的了解，一起解决了为什么要用python（Why）以及怎么用python（How）的问题，在这个系列的最后一讲里，一起再来看看在IC设计的征途中里的案例和一些推荐案例一：大型文件高速比对IC设计里边主要处理的对象还是以文本为主，但是在某些特殊的情况下，文本文件非常巨大，譬如上G的文件。这个时候对文件的查验和比较都是比较麻烦的，尤其对于VIMer而言尤其是困难（由于VIM的设定，是需要将文
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2023-07-13 12:52:25
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1.耦合机理及去耦需求集成电路芯片都有电源引脚，有的甚至有多个电源电压和模拟数字混合电源。无论电源引脚数量如何，每路电源都有其允许范围，包括推荐工作范围和最大绝对值。为防止芯片损坏、保持正常工作，必须遵守这些限制条件。然而，由于噪声和电源纹波导致的电源电压微小变化——即便仍在推荐的工作范围内——也会导致器件性能下降。例如在集成运放中，微小的电源变化会产生输入和输出电压的微小变化，如下图所示： &n
学数字IC的同学都知道的经典问题。延时/时序，是数字电路的核心概念。时序约束，是保证门级电路正常工作的延迟约束，就好像高速公路上行驶的汽车，对其车速和安全车距的要求。速度过快，车距过近，就很容易发生撞车， 而速度过慢，车距过大，就容易造成拥堵。 所以，只有合适的速度和车距要求才能保证高速公路的安全和畅通。门级电路的原理类似，如果从前级寄存器到后级寄存器之间的数据路径，延迟过大，传输过慢，就可能造成
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2024-04-25 20:41:11
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