之前我看了一个很简单的Verilog代码，里面用到 initial：然后综合得到如下电路：我一直误解为这些不可综合的语句是不能出现在设计里面，只能出现在仿真里面的。我以为如果出现在设计里面了也会被忽略掉。但是我发现 initial 里面的语句实际中确实起了作用，它初始化了counter，我把代码（sof）下载到FPGA开发板进 确实是从0开始计数的。然后我咨询了公司的研发工程师，他是这样解答的：i
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2024-05-08 13:54:57
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一：综合产生的文件 前面也讲了一些综合后的需要进行的一些工作，这里就集中讲一下DC完成综合了，产生了一些文件，我们就要查看它生成的网表和信息，下面就来介绍DC综合完成之后要进行哪些工作： 也就是说，DC一般完成综合后，主要生成.ddc、.def、.v和.sdc，.sdf格式的文件（当然还有各种报告和log）.sdc文件：write_sdc -vers
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2024-05-28 10:02:33
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可综合/不可综合可综合：语法结构能与实际硬件电路对应起来不可综合：语法结构不能与实际硬件电路对应起来可综合语句：input、output、parameter、reg、wire、always、assign、begin..end、case、posedge、negedge、or、and、default、if、function、generate、integer、`define，while、repeat 、
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2024-03-25 16:06:53
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可综合模型的结构
如果程序只用于仿真，那么几乎所有的语法和编程语句都可以使用。但如果程序是用于硬件实现，那么我们就必须保证程序的可综合性，即所编写的程序能被综合器 转化为相应的电路结构。不可综合的HDL语句在用综合工具综合时将被忽略或者报错。作为设计者，应该对可综合模型的结构有所了解。
虽然不同的综合工具对
SCAN 命令的保证（guarantees）同一个元素可能会被返回多次。 处理重复元素的工作交由应用程序负责， 比如说， 可以考虑将迭代返回的元素仅仅用于可以安全地重复执行多次的操作上。如果一个元素是在迭代过程中被添加到数据集的， 又或者是在迭代过程中从数据集中被删除的， 那么这个元素可能会被返回， 也可能不会， 这是未定义的（undefined）。顺序迭代缺点： 1.如果后来字典扩容了，比如2
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2024-07-15 15:30:46
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在用ISE设计FPGA电路时，对Verilog HDL语言描述的电路经过综合，得到两种不同的原理图表现形式：由I
原创
2022-04-14 14:51:36
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在用ISE设计FPGA电路时，对Verilog HDL语言描述的电路经过综合，得到两种不同的原理图表现形式：由ISE的界面，可见分别为：RTL Schematic与Technology Schematic，这两者到底由什么区别呢？在我的博文中，凡是用Verilog HDL描述的电路，一般我都会放上这两个原理图。例如：数字时钟计数器来个简单的示例吧：通过仿真和综合认识T触发器（V...
原创
2021-08-20 15:35:06
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Oracle 12C 是由Oracle官方提供的最新版本数据库，Oracle 12C引入了CDB与PDB的新特性，在ORACLE 12C数据库引入的多租用户环境(Multitenant Environment)中，允许一个数据库容器(CDB)承载多个可插拔数据库(PDB)。CDB全称为Container Database，中文翻译为数据库容器，PDB全称为Pluggable Databa
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2024-09-05 06:33:04
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铺垫知识链接1：二极管整理分类（随便看看） 链接2：肖特基(Schottky)二极管与普通二极管的区别（重点） 链接3：AC/DC、DC/DC转换器基础指南(重点)整流二极管作用肖特基二极管就是整流二极管的一种。 【交流电变化为直流电的过程】 其实就是通过来管电源芯片（上图的下方框框）不断地开关来调整占空比来实现输出端的稳定电压。但是电源芯片输出的却是一个有正负电压的脉冲，所以需要一个二极管来实现
介绍就不多说了, wiki上都有. 我这也只是个阅读sicp的笔记.
过程
(define (square x) (* x x)).格式是这样的
:(define (<函数名> <参数列表>) <函数体>). 其中函数名和参数, 以及参数与参数之间用空格隔开. 如何使用呢? 很简单, 比
1 前言（1） 什么是CRC校验？CRC即循环冗余校验码：是数据通信领域中最常用的一种查错校验码，其特征是信息字段和校验字段的长度可以任意选定。循环冗余检查（CRC）是一种数据传输检错功能，对数据进行多项式计算，并将得到的结果附在帧的后面，接收设备也执行类似的算法，以保证数据传输的正确性和完整性。LFSR计算CRC，可以用多项式G（x）表示，G(x)
调强放疗（IMRT）是一种高度精确的治疗技术，要确保患者得到计划设计达到的照射剂量和剂量分布，必须进行患者位置验证和剂量验证。1位置验证位置验证就是验证患者的摆位误差，也就是验证患者在加速器上的体位与定位 CT 扫描时体位的一致性。目前应用较多的是在患者治疗前校正摆位误差，有二维和三维两种方法，三维验证方法是用 MVCT 或 CBCT 与计划 CT 进行比较，属于图像引导放疗的范畴。二维验证方法主
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2024-07-15 01:40:26
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生成块可以动态的生成Verilog代码。可以用于对矢量中的多个位进行重复操作、多个模块的实例引用的重复操作、根据参数确定程序中是否包含某段代码。生成语句可以控制变量的声明、任务和函数的调用、还能对实例引用进行全面的控制。在编程时，应用关键字generate_endgenerate来说明生成的实例范围。生成实例可以是一下的以下一种或多种类型：1）模块 ； 2）用户定语原语 ； 3）门级原
触发器定义:
触发器在数据库里以独立的对象存储，它与存储过程不同的是，存储过程通过其它程序来启动运行或直接启动运行，而触发器是由一个事件来启动运行。即触发器是当某个事件发生时自动地隐式运行。并且，触发器不能接收参数。
触发器(主要)组成:
触发事件：即在何种情况下触发TRIGGER; 例如：INSERT, UPDATE, DELETE。
触
使用两偏SRAM，前后读写。由于中心二倍放大存在UV反色问题，需要使用buffer暂存UV，再将其位置调整至正确。效果如图所示：具体操作请看代码：Video_SRAM.v
module Video_SRAM(
input clk_50,
input clk_27,
//GS2971A设置
output decode_xtal1,
output decode
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2024-07-08 10:57:01
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多通道CIC抽取滤波器Vivado CIC IP核实现实现（3） 前面写了CIC滤波器原理实现MATLAB仿真CIC抽取滤波器MATLAB仿真和FPGA实现（1） 和FPGA代码的实现 CIC抽取滤波器MATLAB仿真和FPGA实现（2） 在实际应用中采用CIC Compiler（4.0）实现更加灵活，但在使用IP核前需要利用MATLAB进行仿真分析后再去使用能做到有的放矢。 在对IP核配置时需
任务任务类似于一段程序，可以使设计者从设计描述的不同位置执行共同的代码段。用任务定义可以将这个共同的代码段编写成任务，从而能够在设计描述的不同位置通过任务名调用该任务。任务可以包含时序控制，即延时，而且任务也可以调用其他任务和函数。1.1任务的定义 定义任务的格式如下：tast [automatic] task_id;
[declarations]...
statements..
一、连线无法自动捕捉时，关闭grid：如上图，点击后变红即可取消最小移动grid单位，可以随意移动；二、更新修改后的网络和off-page：选中根文件——tools——annotate添加offpage页码： 参考：http://www.mazirong.com/archives/2639三、批量修改offpage或net的方法：（参考本博客之前的文章）如图需要修改phy1为
百度百科：http://baike.baidu.com/view/1444566.htm在电子设计自动化中，网表（英语：netlist），或称连线表，是指用基础的逻辑门来描述数字电路连接情况的描述方式。由于逻辑门阵列有着连线表一样的排列外观，因此称之为“网表”。网表通常传递了电路连接方面的信息，例如模块的实例、线网以及相关属性。如果需要包含更多的硬件信息，通常会使用硬件描述语言，例如Verilog
在使用 ng new 新建Angular项目的时候会报一个错误：The Schematic workflow failed. See above.
原创
2024-08-14 11:29:16
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