verilog HDL中定义位宽到底是[高位:0]还是[0:高位] 为什么看到了两种写法

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luoganttcc 2023-01-13 00:40:45 博主文章分类：verilog ©著作权

文章标签 数字电路升序 文章分类 运维

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两种都可以
[高位：0]为降序表示，即高位在前，低位在后
[0：高位]为升序表示，即低位在前，高位在后
使用时哪种方便用哪个，习惯而已

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