tingtang13的博客_Perl,DDR,digital Signal(4)

UVM：2.2只有driver的验证平台->2.2.2加入factory机制

1.先看代码：`ifndef MY_DRIVER__SV`define MY_DRIVER__SVclassm_component parent = null);

sed

字符串

命令行

原创 2023-07-31 17:31:06 51 阅读

Memory Overclocking

source:http://www.hardwaresecrets.com/article/Memory-Overclocking/152/6Changing the Memory Timings

Memory

System

ide

转载 2023-07-31 17:31:02 147 阅读

UVM：9.1.2 callback 机制的必要性

1.对于VIP来说，在driver

测试用例

原创 2023-07-31 17:31:00 40 阅读

UVM：9.1.6 使用callback 函数/任务来实现所有的测试用例

1.也可以将driver 中的drive_one_p

测试用例

原创 2023-07-31 17:30:58 84 阅读

UVM：9.1.4 callback 机制的使用

1.要实现真正的pre_tran，首先要

开发者

原创 2023-07-31 17:30:55 199 阅读

UVM：9.1.7 callback机制，sequence机制和factory 机制

1.callback机制，sequence机制和factory back中很难实现。

测试用例

原创 2023-07-31 17:30:50 78 阅读

Proper Termination for High-Speed Digital I/O Applications

source: http://www.ni.com/white-paper/3854/en/1. Digital Termination Onts

ci

ide

perl

转载 2023-07-31 17:30:48 70 阅读

UVM：9.2.1 Linux 的设计哲学：小而美

在验证平台的设计中，要尽量小而美，避免大而全。

java

原创 2023-07-31 17:30:47 49 阅读

UVM：9.2.3 放弃建造强大sequence 的想法

1.问题是这种sequence 的代码量非常，尽量做到一看名字就知道这个sequence 的用处，方便。

java

原创 2023-07-31 17:30:44 47 阅读

舒服的文档背景色

网上好多的人说是浅绿色的背景色，但是不然，看时间常

背景色

原创 2023-07-31 17:30:43 117 阅读

UVM：9.3.2 UVM 对参数化类的支持

1.uvm 对参数化类的支持体现在fac

参数化

默认参数

原创 2023-07-31 17:30:40 217 阅读

gmake 与 make

gnu make在linux下一般是叫make但是如果是在其他的unix系统

linux

unix

转载 2023-07-31 17:30:39 191 阅读

linux command

不加@时，在运行时，会在窗口显示出这条命令而加了@, 只会显示出

bc

转载 2023-07-31 17:30:36 66 阅读

UVM：10.3.3 disable fork 语句对原则操作的影响

1.很多计数器的类型是W1C，写1清零。但是标志位并没有清除，从而出现错误。

寄存器

原子操作

解决方法

原创 2023-07-31 17:30:36 170 阅读

Problems with wires declared inside verilog generate blocks

http://stackoverflow.com/questions/22200666/problems-wi

ide

转载 2023-07-31 17:30:33 33 阅读

UVM：9.4.3 virtual sequence 与virtual sequencer

1.每个模块的virtual sequenc

寄存器

原创 2023-07-31 17:30:33 175 阅读

UVM：10.5.2 聚合参数的优势与问题

1.使用聚合参数后，可以将此参

测试用例

重用性

赋值

原创 2023-07-31 17:30:31 48 阅读

git常用命令总结

Git命令git配置（config）：git version

git

暂存区

工作区

转载 2023-07-31 17:30:31 29 阅读

UVM：10.4.2 使用单独的参数类

1.需要一种跨越寄存器的约束。要求2个field 的和大于100。只有上节第二种能实现：2.由于这个约束对所有测试都适用，因此希望写在寄存器模型的constraint 里：3.这个寄存器模型使自己手工创建的，没问题。但在IC 中，寄存器模型都是由一些脚步命令）必须时刻保

寄存器

源文件

原创 2023-07-31 17:30:25 73 阅读

UVM：10.2.1 复杂sequence 的简单化

1.之前的my_transacti

测试用例

重用性

IP

原创 2023-07-31 17:30:22 53 阅读

UVM：10.2.2 layer sequence 的示例

1.产生ip_transaction 的sequenc

无限循环

成员变量

原创 2023-07-31 17:30:19 140 阅读

UVM：10.1.1 interface 实现driver 的部分功能

1.之前的interface 非常简单：2.实际

重用性

封装

数据驱动

原创 2023-07-31 17:30:13 290 阅读

UVM：10.1.2 可变时钟

1.可变时钟有3种：1）不同cas

测试用例

原创 2023-07-31 17:30:10 179 阅读

UVM：6.7.3 response handler 与另类的response

1.get_response 和 put_response是一一对应的。当在sequence 中启动ge

空指针

多总线

虚函数

原创 2023-07-31 17:30:09 194 阅读

UVM：6.4.2 在sequence 中使用rand 类型变量

1.transaction 中，使用randomize 进行随机。2.sequence 中也可

修饰符

编译器

字段

原创 2023-07-31 17:30:06 180 阅读

UVM：10.2.3 layer sequence 与try_next_item

1.try_next_item 更加接近实际情况，用的更多：两个

】

原创 2023-07-31 17:30:05 152 阅读

UVM：6.4.1 嵌套的sequence

1.假设产生CRC错误包的sequence 如下：2.长包sequence 如下：

9

原创 2023-07-31 17:30:03 103 阅读

UVM：6.4.5 sequence 的派生与继承

1.从sequence 派生另外一个sequence：1）公用的函数或任务写在base_sequence 中，

子类

父类

原创 2023-07-31 17:29:57 138 阅读

UVM：6.5.1 带双路输入输出端口的DUT

1.为了说明virtual sequence，以带双路输入输出端口的DUT为例：1）相当于在：4.my_case0 中，设置两个default sequence：

输入输出

原创 2023-07-31 17:29:54 88 阅读

UVM：6.5.3 sequence 之间的复杂同步

1.使用全局变量不好，event。2.实现同步的最好方式就是用virtual sequenc

全局变量

赋值

两个指针

原创 2023-07-31 17:29:51 107 阅读

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UVM：2.2只有driver的验证平台->2.2.2加入factory机制

Memory Overclocking

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UVM：9.1.6 使用callback 函数/任务来实现所有的测试用例

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舒服的文档背景色

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UVM：6.4.1 嵌套的sequence

UVM：6.4.5 sequence 的派生与继承

UVM：6.5.1 带双路输入输出端口的DUT

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