Quartus II 上手攻略

原创

zstar_ 2022-08-23 14:33:28 博主文章分类：硬件汇总 ©著作权

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第一次接触EDA实验，对这方面的相关操作并不熟悉。本篇文章结合上课内容和B站Quartus进行整理，总结一下Quartus 这款软件的基本使用。
参考的B站教学链接：《Quartus II 软件安装与入门教程》

Quartus 软件简介

Quartus II 是Altera公司为其FPGA/CPLD芯片设计的集成化专用开发软件，有原理图、VHDL、Verilog HDL等多种设计输入形式，内嵌综合器以及仿真器，可以完成从设计输入、综合适配、仿真到下载的完整FPGA设计流程。

用自己的语言总结：Quartus不仅支持在上面绘制电路，进行仿真，还支持编写代码，并且支持将代码下载到FPGA上。因此，总软件大小比较大，大约15G左右（我的是正版免费的Lite版本）

Quartus 软件下载

关于Quartus软件下载，有个地方需要注意，若要保证其仿真功能的正常运作，在安装界面必须勾选Modelsim。
官网上面有三个版本，前两个大型的是商业版需付费使用，轻量版本Lite可以免费使用。
我在官网下的最新版本并未注意到这个问题，导致仿真时会报错Error loading design 卸载之后，我安装的是Quartus18.1的版本，直接安装即可，一路next。
安装包由B站视频的UP提供：

18.1lite版本下载地址：
链接：https://pan.baidu.com/s/1JMH75Y7l1cW8x_uveJ1pVg
提取码：i83y

仿真流程

详细的仿真流程看视频更为清晰，这里仅放置一些关键设置图。

新建工程时的设置：

Quartus II 上手攻略_电路图

仿真界面的按钮含义：

Quartus II 上手攻略_原理图_02

仿真界面的信号分组操作：

Quartus II 上手攻略_原理图_03

仿真实例：4选1多路选择器

原理图：

Quartus II 上手攻略_verilog_04

verilog代码

仿真可以有两种方式，直接画电路图或者编写verilog代码。
这里采用verilog的方式：
在File->New->选择Verilog HDL File ，写入verilog代码：

module MUX41a(a,b,c,d,s1,s0,y);
  input a,b,c,d;
  input s1,s0;
  output y;
  reg y;
  always @ (a or b or c or d or s1 or s0)
  begin : MUX41
    case({s1,s0})
      2'b00 : y<=a;
      2'b01 : y<=b;
      2'b10 : y<=c;
      2'b11 : y<=d;
      default : y<=a;