位沁CSDN的博客_FPGA

FPGA时钟倍频，分频

1、实验环境Windows 10 64 位  Quartus (Quartus P

引脚

开发板

差分

原创 2022-08-18 17:52:20 1635 阅读

imut_du FPGA作业1

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原创 2022-08-18 17:49:18 138 阅读

imut_du FPGA作业1_步骤详解

一、新建工程1、选择file—PORT(x1, x2

右键

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原创 2022-08-18 17:49:06 46 阅读

imut_du FPGA_作业2

当我对着这个图，根据中间状态A、B、C，E，因为我是

真值表

原创 2022-08-18 17:48:39 93 阅读

VHDL描述语句思维导图

o

原创 2022-08-18 17:45:07 191 阅读

FPGA串口通信

参考连接添加链接描述一、串口、并口、USB接口1、串口叫做串行通信接口，

数据

串口

信号线

原创 2022-08-18 17:35:13 251 阅读

FPGA点亮第一个流水灯

经历了51点灯，32点灯，树莓派点灯后，小du同学迎来了FPGA点灯，FPGA流水

引脚

新建工程

开发板

原创 2022-08-18 17:33:23 257 阅读

FPGA_Verilog 基础模块

Verilog 基础模块参考，黑金动力社区1、数据类型**整数：**整数可以用二进

赋值

运算符

寄存器

原创 2022-08-18 17:32:20 261 阅读

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