(文章目录) 前言 本篇文章将带大家学习Makefile，Makefile在文件的编译中起到重要作用，在Linux中我们也是经常使用到Makefile，下面我将会带大家学习什么是Makefile。 一、Makefile介绍 Makefile是用于自动化构建程序的一种工具，它通常被用于编译，连接以及打包程序等任务。Makefile利用了文件的时间戳，只编译被修改过的文件和和依赖这些文件的文件。这种
(文章目录) 前言 一、Makefile的结构 Makefile 通常由一系列规则组成，每条规则定义了如何从源文件生成目标文件。每个规则又由目标、依赖和命令三部分组成。 下面是 Makefile 规则的基本结构： target: dependencies command1 command2 ... 其中，target 是要生成的目标文件名，dependencies 是生
(文章目录) 前言 本篇文章将讲解Makefile中的伪目标，Makefile的目标在前面的文章中我们已经讲解了那么这篇文章我们就来讲讲伪目标。 一、伪目标概念 Makefile 伪目标是一类特殊的目标，它们的目的是提供给 make 工具一些命令，而不是用来构建文件的。因为伪目标通常不会对应实际的文件，所以它们的目的也不是为了构建文件，而是执行一些特定的操作，如清理编译过的目标文件、运行测试等。
(文章目录) 前言 在C语言等语言中存在变量这个概念那么在Makefile中也是存在变量这个概念的，现在就让我们来学习一下什么是Makefile中的变量。 一、Makefile变量概念介绍 变量是在Makefile中被定义并被赋予特定的值或字符串，这些变量可以在整个Makefile中引用和使用。 在Makefile中定义变量，可以使Makefile更加灵活，便于维护和重复使用代码。变量通常用于存
(文章目录) 前言 上篇文章讲解到了变量的使用，这篇文章继续讲解预定义变量。 一、自动变量的概念 在Makefile中，自动变量指的是可以在编写规则或命令中使用的特殊变量，这些变量的值会根据上下文不同而自动地发生变化，从而可以方便地编写通用的规则或命令。 以下是一些常用的自动变量： $@：目标文件的名称，即规则中的目标（target）。 $<：规则中第一个依赖文件的名称。 $^：规则中所有
(文章目录) 前言 本篇文章开始讲解Makefile中的条件判断语句，在各种编程语言中都存在条件判断语句，Makefile作为一种脚本语言也是有条件判断语句的，那么现在就让我们来学习一下在Makefile中是如何使用的吧。 一、条件判断语句概念讲解 Makefile 中有多个条件判断语句，可以根据不同条件执行不同的命令。以下是常见的 Makefile 条件判断语句： 1.ifeq 和 ifneq
(文章目录) 前言 在Makefile中也是存在函数的，在 Makefile 中，可以使用函数调用来处理变量、字符串和路径等操作。那么下面就来看看是如何在makefile中使用函数的吧。 一、自定义函数 1.使用示例 在 Makefile 中，可以使用自定义函数来完成一些特定的操作。自定义函数一般使用 define 和 endef 命令来实现，在 define 和 endef 之间是函数体。自定
(文章目录) 前言 本篇文章将给大家讲解一下变量的高级主题，变量的拓展，这些主题可以让你更加灵活地编写和维护 Makefile。 一、变量值的替换 1.简单替换 变量替换语法格式： $(var:a=b) 其中，a 可以是一个字母，表示 var 中每个单词结尾的这个字母。b 则是替换的字符串。它会替换每个单词结尾的 a（如果有的话）。 这个语法通常用于修改一些表示文件路径或文件名的变量，以方便进
(文章目录) 前言 本篇文章将给大家介绍make的隐式规则。 一、什么是make的隐式规则 Make 的隐式规则是指 Make 在没有找到显式规则的情况下，会自动使用的一组规则。这些规则是预定义好的，可以被 Make 自动识别和调用，不需要用户指定具体的规则。 隐式规则的使用可以大大简化 Makefile 的编写，特别是当需要编译大量源文件时。隐式规则可以根据不同的文件扩展名自动调用不同的编译命
(文章目录) 前言 在前面的文章中我们的文件全部都是放在同一个目录下面的，那么在实际的工程开发中会这样做吗？答案肯定是不会的，因为将全部的文件放在同一个目录下会显得十分凌乱，这样不便于代码的管理。 一、常用的源码管理方式 我们通常将各个模块的源码分开管理，并且将模块中的.c文件和.h文件也分开管理，这样便于我们代码的移植和管理。 那么通过这样管理后make怎么样来找到对应的文件在哪里呢？ 二、
(文章目录) 前言 本篇文章将讲解include的使用方法，在C语言中使用include是包含头文件，那么在makefile当中使用include的作用是什么呢？ 一、include在makefile中的概念介绍 在 Makefile 中，include 用于在当前 Makefile 中包含另一个 Makefile 或者一个设置环境变量的脚本。可以使用 include 将一个大型的 Makefi
@TOC前言在前面的文章中我们都只使用到了.c文件作为依赖但是在实际的工程中肯定是不可能只有.c文件的还存在.h文件，那么在包含了.h文件后又该如何来包含依赖关系呢？一、makefile不包含.h依赖的后果首先先在目录下新建四个文件夹，其中就包含了fun.h这个文件。makefile：OBJS := fun.o main.o hello : $(OBJS) gcc -o $@ $^ $(O
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