推丸菌在公司听取小弟汇报时，那厮说网表有问题，OrCAD原理图导出，AllegroPCB导入，结果有个节点连不上，但是在原理图上是同样的网络名。有妖气啊！看了他的原理图，我觉得很生气~太不规范了，难怪会出现错误。但是为了多种兼容，也不得不做各种妥协~想到这里我也不生气了。原版原理图就不贴出来了，推丸菌在这里模拟一下。哦，对了，以下所有案例均基于Cadence17.2版本。那么猫腻出来了，第一页的V
JTAG（JointTestActionGroup）是一个接口，为了这个接口成立了一个小组叫JTAG小组，它成立于1985年，比推丸菌的年龄还大。在1990年IEEE觉得一切妥当，于是发布了IEEEStandard1149.1-1990，并命名为StandardTestAccessPortandBoundary-ScanArchitecture，这就是大名鼎鼎的JTAG了。JTAG的三大功能你知道
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